几张图让你轻松理解DDR的串扰【博业体育平台登录】

让你评估高速串行信号的串扰，你不会说道它们的串扰在－40db以下，没什么影响。但是如果让你评估像DDR这种分段信号的串扰，你说道DQ0和DQ1的串扰－30db，DQ1和DQ2的串扰－25db，DQ2和DQ3的串扰……你渐渐数，我再行回头了。根据以往的经验，今天大家都会怀著无比沈重的心情回到公司下班，高速先生也回应深深的解读哈，所以今天的文章是十分的简练而形象的，以便符合大家今天想多动脑的性欲。忘记前几篇文章提及过人工智能的话题，我们就接着说道一点技术上的东西哈。

在人工智能很快掘起的热潮中，作为核心算力的DDR模块毫无疑问出有了一次相当大的风头。因为在执着超大算力的情况下，人们对DDR的容量和速率拒绝更加低。我们高速先生认识的算力卡一块比一块小，但是板内的DDR模块却有更加多的趋势，动不动就上4地下通道、8地下通道，甚至更加多。

而且在颗粒数量大大提升的同时，我们拒绝的速率基本也更加低，基本都是2400Mbps跟上，最低的有做到过3200Mbps的。再加板子密度更加小，从我们这一年多以来认识的各种DDR的设计来看，可以从不滑稽的和大家说道，现在DDR的设计可玩性有可能早已多达了很多人的想象了……做到过DDR设计的同行都告诉，在十分契的颗粒化学键下，想要顺利的把所有的信号纳出来有可能都要去条命，然后导通之后还要夹住抓稳去做到响一下竟然你想要捏手的二分（5mil，2mil，我们有见过客户拒绝做到1mil的……），当你以为可以收工的时候，客户还要抱着看起来和你商量的态度说道你的间距能无法再行冲破一点。

行……我们的设计工程师是十分缜密的，能冲破1mil也是爱人的，虽然有可能自己也不告诉辛辛苦苦冲破的1mil究竟有什么用，就样子做到等宽的时候辛辛苦苦做到的2mil二分有什么用是一样一样的。一般的结果都是这样的：我们工程师经过大大绝望之后，时间也去得差不多了，客户也再一关心了我们工程师的伤痛，大家再一擅自达成协议了共识：艰辛了，要不就这样好了。

再一，不必再行做到更加严苛的二分了，再一不必再行冲破0．5mil的间距了。虽然客户的内心是在想要：只不过应当还可以之后……那等宽作好了，间距也看上去无法再行冲破了，转交我们SI成员展开建模，在我们的眼中这样的一组数据信号的结果早已是十分不俗了。大约是这样的：从这两组数据信号眼图的Aperture来看，整个低低电平的裕量是十分大的，这样的眼图在实际调试认同是PASS的。但是如果我把一些point标出来让大家再行看同一个眼图的话，你们可能会实在有点吃惊：为什么我的等长都做了2mil，间距也早已冲破到无法再行进了，但是看这两组数据的延时竟然劣了慢50ps（右图蓝色mask），电平上面的幅度波动也多达了100mV（右图红色mask）。

数据信号是严苛点对点的信号，我们的电阻是40欧姆，然后我们的芯片驱动和芯片接管的ODT也是40欧姆，那说明了这样的延时和电平波动并不是由电阻不给定的光线导致的（最少很大部分不是）。那这个时候我们又把目光集中于到了很难分析的串扰了。

从我们的专业角度来看，的确是串扰要腹这个锅。在这里我们不说道一些很简单的理论和公式，我们仅有以下面的几张图来让大家解读串扰究竟是怎么影响到我们的电平波动和延时的。邻接的两根线会有3种传输的模式，分别是下面这样的：然后反击信号超过接收端之后，他们的结果是这样的：这里问你们有可能想问的两个问题：1，为什么超过的时间不会不一样？共模速度慢，差模速度快，惯性分列中间。

因为在共模的影响下，两线之间的容性最强；在差模的影响下，两线的容性最弱，这时就样子差分线一样，两线相参照，因此传输延时最慢。2，为什么电平幅度不一样？某种程度，共模的时候两线电平是同方向的，相互补足，幅度偏高；差模的时候两线的电平反昭雪向，相互抵销，幅度减少。

所以当这两根线跑完有所不同的随机码型时，你看见的其中一根线的信号是下面这样的就不怪异了。再行返回我们上面的一组DDR数据信号，对于他们而言就更加简单了，一组8根DQ再加DM信号都具有有所不同的码型，相互之间的串扰影响就造成了他们的眼图呈现有所不同的延时和电平波动了。只不过理论有可能很简单，但是他的表现形式就是这样的。

总之，对于像DDR这种分段信号的串扰，还是在时域的角度上去分析不会更加直观和有说服力。当然可玩性也放在这里，你必需把整组信号乃至整个地下通道的信号一起分析，才能获得串扰影响的最大化。

所以呢，我们做到了5mil甚至更加小的等长和上面建模波形的50ps来比，知道是很微不足道。实质上串扰在DDR模块里的确不会有更为严重的影响，比如说一下，我们在高速串行信号里面5mV的串扰都实在十分大了，在DDR模块里竟然能有上百mV。

当然两者还是有相当大差异的，高速串行信号的眼图裕量目前和DDR比起还是小很多，一般只有100mV以内，我们目前的DDR系统的高低电平的裕量有几百mV，而且DDR的速率也要求了走线的损耗基本对它没有太多的影响。所以我们对100mV的串扰结果还是可以拒绝接受，而且从整个波形来看，裕量也还是相当大。

但是随着DDR的电平越来越低，适当的裕量认同也不会更加小，到那时候串扰有可能就不会影响很相当严重了。

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